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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计讨论(IC前端|FPGA|ASIC) › 设计题目：实时钟
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楼主: atuhappy

设计题目：实时钟

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jackzhang
发表于 2003-10-21 20:19:29 | 显示全部楼层

设计题目：实时钟

别忘了，先写文档，请把设计文档一起提交上来
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lixf
发表于 2003-10-28 10:29:05 | 显示全部楼层

设计题目：实时钟

其实就是60进制计数器的设计。
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greenpine
发表于 2003-10-31 11:10:38 | 显示全部楼层

设计题目：实时钟

输入一个时钟，在加个分频器
设置时间日期可能比较复杂一些
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mqgzhh
发表于 2004-5-13 22:39:13 | 显示全部楼层

设计题目：实时钟

hehe,俺也正研究这个呢。32.768KHz的。谁介绍一下？
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xddjd
发表于 2004-6-4 09:52:02 | 显示全部楼层

设计题目：实时钟

各位老大，这个我做过，只不过是好像有点小问题，另请问一下怎么样设计文档是什么样的？在小公司，不做设计文档，有没有什么格式，要求？
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yh919
发表于 2005-8-15 18:20:01 | 显示全部楼层

设计题目：实时钟

斑竹啊,什么时候能公布作品?我很想看看.
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yh919
发表于 2005-8-16 16:40:56 | 显示全部楼层

设计题目：实时钟

还有24进制。
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