jium007 朋友在不??请教问题

pyy1980 · 发表于 2010-4-26 14:55:39

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你发我的程序我在ISE里面仿镇老是过不了了,,,老抱错误,,不知道你对ISE了解多少>???可以帮我仿真一下不??/

pyy1980 · 发表于 2010-4-26 15:00:50

ERROR:Cpld:837 - Insufficient number of macrocells. The design needs at least 38 but only 36 left after allocating other resources.
Device 9536XL44VQ was disqualified.
ERROR:Cpld:868 - Cannot fit the design into any of the specified devices with the selected implementation options.

pyy1980 · 发表于 2010-4-26 15:01:56

老出现这个错误,现在我的想法是用VHDL和VERLOG一样,,,老抱错误不知道如何整了

pyy1980 · 发表于 2010-4-26 15:27:19

管脚描写

pyy1980 · 发表于 2010-4-26 17:05:40

DDDDDDDDDDDDDDDDDDD

jium007 · 发表于 2010-4-26 20:40:26

没用过ISE，都用的ALTERA的器件，这个说的是你cpld的资源不够，cpld的话寄存器资源比较少。

jium007 · 发表于 2010-4-26 20:41:54

你还加了其他的逻辑不

jium007 · 发表于 2010-4-26 20:43:57

cpld的话要少用寄存器资源。。

jium007 · 发表于 2010-4-26 20:45:40

你换个fpga器件仿真看看能不能过

pyy1980 · 发表于 2010-4-27 08:06:29

我用的是XINLIN的CPLD9536..老过不了

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