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本帖最后由 songspirit 于 2010-4-23 20:34 编辑
请问,我用Astro导出gds文件到Cadence,用Calibre做DRC仿真,有LUP.4g的错误
具体是LUP.4g{ @ width of th N+ guard-ring, P+ guard-ring, N+ STARP and P+ STRAP for the Active connected to an I/O pad, and also
MOS within 20um space from the MOS connected to an I/O
pad , >=0.42um. } 的错误。错误提示的位置是I/O pad的外边缘,
就是在整个芯片(包含I/O Pad)的最外围。
请各位大虾不吝赐教。哪怕是错误可能原因的猜测也好。谢谢! |
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