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楼主: jmwang

[讨论] 有关运放offset电压仿真问题

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发表于 2012-2-4 12:24:12 | 显示全部楼层
sesese
发表于 2012-2-6 13:33:47 | 显示全部楼层
thanks
发表于 2012-2-7 17:14:48 | 显示全部楼层
顶一下!
发表于 2012-2-8 09:43:08 | 显示全部楼层
支持sillier。 他说得很对。
发表于 2012-2-8 14:09:51 | 显示全部楼层
TSMC,GF和SMIC都有mismatch lib的,保密级别高,需要向厂方去要
另外一半意义上CMOS工艺输入对管L>=2um,W*L>=200um^2可以了,+/-10mV没问题
高速的比较麻烦1G的测试也就+/-30mV
发表于 2012-2-8 15:21:55 | 显示全部楼层
感谢分享!
发表于 2012-3-5 23:19:09 | 显示全部楼层
好帖子,真给力
发表于 2012-3-6 22:34:52 | 显示全部楼层
谢谢楼主,不错~~~~
发表于 2012-3-7 14:03:34 | 显示全部楼层
MC 仿真Mismatch还是很有价值的
发表于 2012-3-7 14:40:33 | 显示全部楼层
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