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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › Altera FPGA CPLD设计基础篇
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楼主: hjchen01

[资料] Altera FPGA CPLD设计基础篇

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lian20118
发表于 2012-5-13 12:52:50 | 显示全部楼层
vhaoxongxi
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gaoshimeng
发表于 2012-6-12 15:03:10 | 显示全部楼层
楼主可以把附件重新打包一下，现在论坛的附件大小上限提高了
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gaoshimeng
发表于 2012-6-12 15:10:28 | 显示全部楼层
否则这么多附件太难下载了
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gaoshimeng
发表于 2012-6-12 15:12:06 | 显示全部楼层
我的信元已经耗光了啊
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gaoshimeng
发表于 2012-6-12 15:13:42 | 显示全部楼层
还好只剩两个分卷，再回一帖就下载完了。。。坑人啊
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niubidea
发表于 2012-6-30 10:45:41 | 显示全部楼层
没米 啊
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200541075
发表于 2012-7-8 18:09:16 | 显示全部楼层
很需要，多谢分享
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tamahome7
发表于 2012-7-28 06:42:24 | 显示全部楼层
谢谢啦
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manoj123
发表于 2012-8-21 13:42:58 | 显示全部楼层
good data. too much
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zhpg009
发表于 2012-9-16 09:38:12 | 显示全部楼层
赚钱吧
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