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xilinx中的总线引出问题

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发表于 2006-8-22 17:25:01 | 显示全部楼层 |阅读模式

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请问各位高手,在xilinx 的画图里面,碰到一束8根的或16根的总线时,怎么把这些线一根根地引出来和其它线连接?
发表于 2006-8-23 01:11:06 | 显示全部楼层
比如 bus(15:0) 先将16位总线接出来,然后随便用就行了 例如:bus(1) ,bus(15:13)
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发表于 2006-9-7 20:07:11 | 显示全部楼层
为什么还使用画原理图的方法呢,这在很简单的逻辑时还能用用,但是面对庞大的逻辑时根本无法使用,还是应该多使用编程语言来锻炼一下
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发表于 2006-9-8 16:41:55 | 显示全部楼层
现在是rtl输入时代。
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