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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › Verilog 和 VHDL 語言互相轉換
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楼主: samsax123

[资料] Verilog 和 VHDL 語言互相轉換

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发表于 2012-6-16 17:54:13 | 显示全部楼层
谢谢！下来研究一下！
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lylyhs
发表于 2013-2-4 10:58:38 | 显示全部楼层
谢谢分享
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发表于 2013-7-23 15:47:57 | 显示全部楼层
要licence啊。
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hiee
发表于 2013-8-4 03:16:09 | 显示全部楼层
好东西，正需要，谢谢，
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发表于 2013-8-4 18:01:47 | 显示全部楼层
下来 研究下，支持一下
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发表于 2013-8-5 11:30:08 | 显示全部楼层
多谢楼主分享!
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发表于 2013-9-15 11:56:46 | 显示全部楼层
看看好不好用
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molys
发表于 2013-10-26 18:48:58 | 显示全部楼层
这个软件好用吗
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ciper80
发表于 2014-3-10 15:04:00 | 显示全部楼层
好东西，看看！
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发表于 2014-3-10 17:25:49 | 显示全部楼层
这东西好用么？
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