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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog/RF IC 设计 › Analog/RF IC 资料共享 › 基于VHDL语言的卷积码编解码器的设计
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楼主: zjllh

[原创] 基于VHDL语言的卷积码编解码器的设计

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mp0013
发表于 2010-1-7 19:53:56 | 显示全部楼层
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mp0013
发表于 2010-1-7 19:55:07 | 显示全部楼层
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mp0013
发表于 2010-1-7 19:56:19 | 显示全部楼层
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feixuyang2008
发表于 2010-1-7 19:57:17 | 显示全部楼层
好，谢谢
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mp0013
发表于 2010-1-7 19:57:31 | 显示全部楼层
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mp0013
发表于 2010-1-7 19:58:38 | 显示全部楼层
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mp0013
发表于 2010-1-7 19:59:49 | 显示全部楼层
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mp0013
发表于 2010-1-7 20:01:00 | 显示全部楼层
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mp0013
发表于 2010-1-7 20:02:10 | 显示全部楼层
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mp0013
发表于 2010-1-7 20:03:21 | 显示全部楼层
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