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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › IC验证 › IC验证资料 › vmming a systemverilog testbench (example for fifo)
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楼主: qinghuabing2008

[原创] vmming a systemverilog testbench (example for fifo)

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xuri2009
发表于 2010-1-29 19:49:23 | 显示全部楼层
夏虫了
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clarbee
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发表于 2010-2-11 13:09:33 | 显示全部楼层
提示: 作者被禁止或删除 内容自动屏蔽
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kajaljain
发表于 2010-2-28 14:42:40 | 显示全部楼层
eetrop
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modelsim64
发表于 2010-3-2 15:06:20 | 显示全部楼层
thank you
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modelsim64
发表于 2010-3-2 15:07:37 | 显示全部楼层
thanks
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modelsim64
发表于 2010-3-2 15:10:05 | 显示全部楼层
thank you
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lewishamil
发表于 2010-3-5 11:38:58 | 显示全部楼层
thanks
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diligent15
发表于 2010-3-5 21:02:25 | 显示全部楼层
rgtrwt ret rete rtr
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fdoo
发表于 2010-3-8 02:48:09 | 显示全部楼层
very nice!
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chengjiao
发表于 2010-3-21 16:51:52 | 显示全部楼层
thank you very much
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