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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › IC验证 › IC验证资料 › 使用vcs仿真sv时，怎么写makefile
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楼主: 张曼玉

[转贴] 使用vcs仿真sv时，怎么写makefile

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charles_fpga
发表于 2011-12-14 20:04:57 | 显示全部楼层
怎么下不了呀
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HUST_EST
发表于 2011-12-23 10:40:21 | 显示全部楼层
不得不下的好资料
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jinnon
发表于 2011-12-23 10:50:04 | 显示全部楼层
回复 1# 张曼玉


    参考参考
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zyz013920
发表于 2012-2-15 16:58:10 | 显示全部楼层
学习学习！
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coolzc
发表于 2012-2-19 23:46:49 | 显示全部楼层
好东西 来顶一下
畅销就业培训课《芯片验证从入门到精通》推荐就业，赢取高薪！
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lordback
发表于 2012-2-20 09:48:20 | 显示全部楼层
谢谢LZ分享，好资料！
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blueandy
发表于 2012-3-5 14:19:56 | 显示全部楼层
thank you!!!!!!
畅销就业培训课《芯片验证从入门到精通》推荐就业，赢取高薪！
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zhongdong911
发表于 2012-5-16 20:00:56 | 显示全部楼层
学习一下~~~~
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Avalon
发表于 2012-5-16 20:51:35 | 显示全部楼层
thanks!!!
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hhc789
发表于 2012-5-17 09:47:34 | 显示全部楼层
楼主，这种makefile 和编译c语言的时候用的makefile有什么区别没有？
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