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楼主: lshrrr

[资料] Digital VLSI chip design with cadence and synopsys CAD tools

发表于 2010-1-3 22:37:53 | 显示全部楼层

有中文版的，谁能传上来就好了。

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发表于 2010-1-6 16:41:35 | 显示全部楼层

hi i need this book

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发表于 2010-1-6 16:42:41 | 显示全部楼层

the second part

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发表于 2010-1-6 16:44:13 | 显示全部楼层

how to run submodule in verilog code

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发表于 2010-1-6 16:45:15 | 显示全部楼层

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发表于 2010-1-6 16:47:03 | 显示全部楼层

the last part and thanks for donation

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发表于 2010-1-6 22:48:13 | 显示全部楼层

fei chang hao

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发表于 2010-1-6 22:49:43 | 显示全部楼层

dffdsfd

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发表于 2010-1-6 22:51:08 | 显示全部楼层

thanks very much for your sharing

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发表于 2010-1-6 23:55:51 | 显示全部楼层

thanks

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