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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › IC验证 › IC验证资料 › VMM for SystemVerilog （夏宇闻 中文版）
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楼主: saintgang

[资料] VMM for SystemVerilog （夏宇闻 中文版）

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zindy
发表于 2014-1-26 12:48:24 | 显示全部楼层
每个包3个，要花30个，变成穷人了
畅销就业培训课《芯片验证从入门到精通》推荐就业，赢取高薪！
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yqnie
发表于 2014-2-3 12:55:58 | 显示全部楼层
GOOD, UP
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magicxiaobopsu
发表于 2014-2-16 13:16:03 | 显示全部楼层
THANKS
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magicxiaobopsu
发表于 2014-2-16 13:16:35 | 显示全部楼层
thanks
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liuxuejielxj
发表于 2014-3-26 17:05:28 | 显示全部楼层
看看啊
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liuxuejielxj
发表于 2014-3-26 17:07:32 | 显示全部楼层
这包也太多了吧
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liuxuejielxj
发表于 2014-3-26 17:08:10 | 显示全部楼层
不知道有没有用啊，希望有用啊
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zhaowentao
发表于 2014-3-30 14:28:27 | 显示全部楼层
谢谢分享！！！
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110500623
发表于 2014-4-12 14:49:08 | 显示全部楼层
花了好多钱啊
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allenzmj
发表于 2014-5-5 16:54:34 | 显示全部楼层
那么多包 确实有点狠了 不过还是很有用的 谢谢了
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