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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › IC验证 › IC验证资料 › VMM for SystemVerilog （夏宇闻 中文版）
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楼主: saintgang

[资料] VMM for SystemVerilog （夏宇闻 中文版）

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jinjinxinyi
发表于 2010-7-3 16:00:30 | 显示全部楼层
谢谢！
畅销就业培训课《芯片验证从入门到精通》推荐就业，赢取高薪！
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jinjinxinyi
发表于 2010-7-3 16:03:41 | 显示全部楼层
谢谢！
畅销就业培训课《芯片验证从入门到精通》推荐就业，赢取高薪！
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peter_wx
发表于 2010-7-5 12:17:40 | 显示全部楼层
too many package, too expensive
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oscillator_cn1
发表于 2010-7-5 20:01:52 | 显示全部楼层
骗人，都不能用了:'(
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chibijia
发表于 2010-7-10 10:51:03 | 显示全部楼层
中文版？？
畅销就业培训课《芯片验证从入门到精通》推荐就业，赢取高薪！
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cylasic
发表于 2010-7-10 20:22:32 | 显示全部楼层
好东西，就是不知道老夏的翻译水准怎么样 11# saintgang
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wanghengben
发表于 2010-7-10 22:19:51 | 显示全部楼层
fhfshg
畅销就业培训课《芯片验证从入门到精通》推荐就业，赢取高薪！
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wanghengben
发表于 2010-7-10 22:21:38 | 显示全部楼层
fdgdfgdf
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wanghengben
发表于 2010-7-10 22:30:35 | 显示全部楼层
sfafdsaf
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wanghengben
发表于 2010-7-10 22:32:25 | 显示全部楼层
sdafdsaf
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