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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › NC-verilog 仿真教程和实验实例
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楼主: younghorse

[资料] NC-verilog 仿真教程和实验实例

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dahai500
发表于 2011-6-11 22:10:39 | 显示全部楼层
小顶一下。。。
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IChina
发表于 2011-6-20 11:52:44 | 显示全部楼层
学习了
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servingapples
发表于 2011-7-31 17:05:15 | 显示全部楼层
mark 一下
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hekai618
发表于 2011-8-14 23:41:39 | 显示全部楼层
学习学习！！
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autumnyun
发表于 2011-8-16 10:34:07 | 显示全部楼层
xiexiexiexie
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少将师长
发表于 2011-8-17 09:46:15 | 显示全部楼层
学习了………………
EETOP创芯人才网职位发布入口
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randolf
发表于 2011-10-15 16:52:32 | 显示全部楼层
感謝分享資料
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sunnyzcy
发表于 2011-11-20 13:03:23 | 显示全部楼层
好像这个是比较有用的。cadence自带
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guduxc
发表于 2011-12-8 20:27:30 | 显示全部楼层
正需要学习！谢谢分享！
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demoncxw
发表于 2011-12-30 15:18:34 | 显示全部楼层
谢谢楼主
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