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问一个fpga设计问题,设计时速度是ns级的,在输入是ms级时是不是可以运行良好呢

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发表于 2004-10-11 21:50:36 | 显示全部楼层 |阅读模式

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就是在仿真在ns级可以运行,下到片子里可以在ms级信号时运行吗
发表于 2004-10-11 23:12:29 | 显示全部楼层

问一个fpga设计问题,设计时速度是ns级的,在输入是ms级时是不是可以运行良好呢

要看你是前仿真还是后仿真了,前仿真的时钟频率没什么参考价值。如果是后仿大部分情况下没问题。
发表于 2004-10-12 12:52:05 | 显示全部楼层

问一个fpga设计问题,设计时速度是ns级的,在输入是ms级时是不是可以运行良好呢

这个问题比较复杂。
(1).假设这个信号是一个时钟输入信号,其后接了一个DLL,那么如果时钟频率超过了DLL的输入范围,那么显然不能正常工作。
(2).假如该信号是一个普通信号,那就要看后级逻辑对该信号的使用情况了;
(3).这个还与器件和信号的电气特性有关。
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