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对于异步FIFO的探讨

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发表于 2009-10-26 10:08:00 | 显示全部楼层 |阅读模式

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一个异步FIFO,输入位宽/输出位宽=1/2,那么读写时钟rclk、wclk是否一定也一定要满足wclk/rclk=2/1?  ALTERA的MegaWizard中的FIFO说明书中有个不同输入输出位宽的例子,但他的时钟也是倍数关系,这种关系是必要的吗?
发表于 2009-11-13 20:15:30 | 显示全部楼层
应该不是吧~~~
发表于 2009-11-13 20:40:26 | 显示全部楼层
时钟是独立的,没有关系。
发表于 2009-11-18 16:58:39 | 显示全部楼层
具体问题具体分析吧。
都可以,看具体使用环境。
发表于 2009-11-18 23:30:28 | 显示全部楼层
时钟是独立的,没有关系,关键是想要用多大的速度读写吧,看需求
发表于 2009-11-21 17:22:29 | 显示全部楼层
FIFO比DPRAM好弄多了,就是一个先入先出的东西,一弄就行
发表于 2009-11-21 22:46:42 | 显示全部楼层
肯定不需要相同的倍数。
发表于 2009-11-21 23:50:59 | 显示全部楼层
既然是异步fifo,那就没有办法用sta工具进行分析,而只能用设计来保证。大多数情况下要用到gray码来传递读写指针
发表于 2009-11-22 01:43:36 | 显示全部楼层
没有必要了,时钟与读数据速率不是一个概念,也许有很快的时钟,但很多个时钟周期才读写一次
发表于 2009-11-22 09:22:14 | 显示全部楼层
时钟是独立的,没有关系
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