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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › IC验证 › IC验证资料 › SystemVerilog 的VMM 验证方法学
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楼主: xiaoxiaoyuwts

SystemVerilog 的VMM 验证方法学

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zzg207
发表于 2012-5-22 23:05:10 | 显示全部楼层
必须顶！！！~！
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lyysong
发表于 2012-6-17 17:01:55 | 显示全部楼层
好资料，谢谢楼主
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lyysong
发表于 2012-6-17 17:03:47 | 显示全部楼层
回复 1# xiaoxiaoyuwts


    好资料！
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lyysong
发表于 2012-6-17 17:05:07 | 显示全部楼层
nice！下份资料不容易啊
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xuel0532
发表于 2012-7-4 22:01:34 | 显示全部楼层
不错的资料
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seabeam
发表于 2012-8-10 22:22:31 | 显示全部楼层
好东西，很全，不过还是没找到最想要的
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tjuyfb
发表于 2012-8-25 16:30:39 | 显示全部楼层
下来看看
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zjwwmh
发表于 2012-8-25 17:11:42 | 显示全部楼层
谢谢分享！！！！！！！！！！！！！
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chenyoyo
发表于 2012-9-29 16:34:26 | 显示全部楼层
Thanks very much
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chenyoyo
发表于 2012-9-29 16:35:06 | 显示全部楼层
thanks very much, studying,hehe
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