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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › IC验证 › IC验证资料 › SystemVerilog 的VMM 验证方法学
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楼主: xiaoxiaoyuwts

SystemVerilog 的VMM 验证方法学

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lyq2966
发表于 2010-12-24 14:56:49 | 显示全部楼层
kankan!!!!!!!!
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lioncjj
发表于 2010-12-25 02:34:45 | 显示全部楼层
好资料多谢贡献，辛苦
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neuqliang
发表于 2010-12-25 08:35:11 | 显示全部楼层
谢谢楼主分享
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yoga
发表于 2010-12-25 14:07:03 | 显示全部楼层
谢谢分享
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bswpin
发表于 2011-1-16 23:12:08 | 显示全部楼层
下来看看
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wyx-1987
发表于 2011-5-28 22:57:57 | 显示全部楼层
谢谢分享
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wyx-1987
发表于 2011-5-28 22:59:11 | 显示全部楼层
谢谢分享
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wuxy6184052
发表于 2011-6-8 21:04:04 | 显示全部楼层
Thanks a lot
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antilope
发表于 2011-8-13 19:06:39 | 显示全部楼层
thanks very much
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antilope
发表于 2011-8-13 19:08:13 | 显示全部楼层
thanks very much
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