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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog/RF IC 设计 › Analog/RF IC 资料共享 › Cadence的verilog-A教程
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楼主: hunewton

Cadence的verilog-A教程

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lattern
发表于 2010-3-2 17:48:39 | 显示全部楼层
谢谢分享！
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rj_lancelot
发表于 2010-3-6 19:28:59 | 显示全部楼层
没看懂，。。。
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llyygg
发表于 2010-3-21 14:25:15 | 显示全部楼层
感謝分享
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whhit264209
发表于 2010-3-22 14:35:16 | 显示全部楼层
谢谢！！！！！！
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chipsnowman
发表于 2010-3-22 14:40:31 | 显示全部楼层
太感谢了，正好要用到
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zm2010
发表于 2010-3-22 21:00:24 | 显示全部楼层
谢谢楼主！顺便问一下，用Hspice编译完Verilog A后生成cml文件后，应该怎样继续电路仿真呢？
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mgshen
发表于 2010-3-24 16:09:25 | 显示全部楼层
very good
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xsjyahoo
发表于 2010-3-26 14:13:30 | 显示全部楼层
THX VERY A LOT
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nicekakaka
发表于 2010-3-26 21:56:22 | 显示全部楼层
Thank you
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xiaoyezi111
发表于 2010-3-28 13:05:14 | 显示全部楼层
谢谢！下载了
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