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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › AES加密算法（128）位的verilog实现
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楼主: flysunny

AES加密算法（128）位的verilog实现

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发表于 2013-1-19 17:06:55 | 显示全部楼层
谢谢分享！！
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发表于 2013-1-19 17:07:49 | 显示全部楼层
給你加加油，AES也滿厲害的啦!
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发表于 2013-1-24 16:34:42 | 显示全部楼层
说个谢谢那是必须的哈
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发表于 2013-1-24 19:52:19 | 显示全部楼层
过来学习了~~
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发表于 2013-4-19 13:36:15 | 显示全部楼层
拿来用来检查我的解码试试！
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发表于 2013-4-19 13:43:20 | 显示全部楼层
have  a  look
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zch74
发表于 2013-4-20 11:55:27 | 显示全部楼层
谢谢楼主，好好学习加密方法；
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xiongdl
发表于 2013-4-27 16:32:01 | 显示全部楼层
不错不错ＡＥＳ还是很有用的
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发表于 2013-7-2 17:40:40 | 显示全部楼层
好像是个好东西 谢谢楼主分享
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lijfzcm
发表于 2013-9-12 15:44:33 | 显示全部楼层
瞅一瞅看一看
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