modelsim 总是出错

netantss · 发表于 2009-6-5 11:39:39

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# vsim gate_work.counter_vlg_tst
# ** Error: Failure to obtain a verilog simulation license.
# Error loading design

defuruier · 发表于 2009-6-5 23:02:04

看这错误提示似乎是破解不成功

heaven66 · 发表于 2009-6-6 00:38:44

good thank

lazy_onekk · 发表于 2009-6-19 00:41:47

Did you see that "Failure to obtain a Verilog simulation license"...
If your modelsim installed in windows OS, you should add "LM_LICENSE_FILE" in your sourch path for modelsim license.

cyflamingo · 发表于 2009-6-19 11:51:55

License没有或者出错，网上搜以下相应版本的生成工具就好，然后把license的路径加在win的环境变量里面，如果是Linux那么加在.bashrc或者.cshrc里面就好了

FPGAyatai · 发表于 2011-1-3 16:01:16

我的也有这个毛病

FPGAyatai · 发表于 2011-1-3 16:02:37

回复 5# cyflamingo

我的设置了之后还是报错，不知为何

modelsim 总是出错

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