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楼主: scallion

设计与验证-Verilog HDL(PDF)

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发表于 2017-2-16 21:18:03 | 显示全部楼层
thanks for sharing
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发表于 2017-2-17 08:31:24 | 显示全部楼层
谢谢分享
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cdting
发表于 2017-3-15 05:00:25 | 显示全部楼层
非常感謝~~~~
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发表于 2017-3-20 09:56:07 | 显示全部楼层
利用verilog 在Quartus中实现 输入四组数据的排序。代码在设计中非常具有参考性
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发表于 2017-5-26 13:36:09 | 显示全部楼层
感谢！
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发表于 2017-5-27 17:41:48 | 显示全部楼层
Thanks for sharing!
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发表于 2017-8-13 21:09:07 | 显示全部楼层
谢谢分享！！！
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发表于 2017-8-28 13:41:01 | 显示全部楼层
学习一下，谢谢楼主分享
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发表于 2017-9-17 21:59:20 | 显示全部楼层
谢谢分享
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菁瑩
发表于 2018-2-27 11:36:25 | 显示全部楼层
不知道楼主有没有光盘的内容啊？
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