sigma-delta modulator 输入电压幅度与量化器范围，运放满摆电压的关系

longqingshan · 发表于 2009-5-15 09:55:18

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sigma-delta modulator 输入电压幅度、量化器范围（1bit）、运放满摆电压、vref之间一般取什么比例范围；

liuxing503 · 发表于 2010-8-23 14:40:51

不知道现在这个问题有答案了没有？我需要啊，呵呵。

kuohsi · 发表于 2010-8-23 16:02:01

一個A/D的Vref看你如何決定，假設我的系統Vref=0.5V，
那麼输入电压幅度 <= Vref.
也就是說输入电压幅度不超過0.5V。

运放(OPA)满摆电压(output swing)必定要大於系統的Vref，
不然非線性成分很大。

steve_guo_1997 · 发表于 2010-8-23 21:25:01

1# longqingshan
depend on 你的modulator结构，积分器的gain，....。不同结构会不一样。
具体可由你的系统模型而定。

“运放(OPA)满摆电压(output swing)必定要大於系統的Vref"
真的是这样吗？呵呵

liuxing503 · 发表于 2010-8-24 09:22:35

希望做一个16位的sigma delta ADC，输入范围1.6V~4.4V，需要转差分信号，经过分析决定采用二阶差分开关电容调制器实现，过采样率256，信号带宽51.2KHz，时钟信号26.2144MHz，我希望采用的调制器电压为5V，请教各位大虾，我怎样将1.6V~4.4V输入转换为差分输入？转换后的差分输入范围是多少合适？二阶调制器的系数我想取为0.5，一位比较器的电平如何确定？请各位大虾多多指点！！！！