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数字设计集合

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发表于 2009-5-10 00:10:23 | 显示全部楼层 |阅读模式

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DC PT 经典时序约束范例.rar

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Verilog HDL高级数字设计.txt

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基于FPGA的16点FFT快速傅立叶变换的verilog源代码.rar

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ic设计考题.rar

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FFT变换的IP核的源代码.rar

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时间约束基础.pdf

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UART源代码和验证.rar

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发表于 2009-5-10 01:34:37 | 显示全部楼层
非常不錯的資料,感謝樓主熱心分享。
发表于 2009-5-10 10:56:59 | 显示全部楼层
谢谢楼主
发表于 2009-5-12 19:45:31 | 显示全部楼层
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发表于 2009-5-12 19:56:28 | 显示全部楼层
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