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原帖由 seetoo 于 2009-4-28 12:17 发表 登录/注册后可看大图 设计了一个10bit每级1.5bit 运放共享的流水线ADC,当差分输入均接共模输入电压时,输出码不是511,而是有所偏差。 一共3块测试板,一块输出码为485,一块为540,一块为604, 各位做过ADC的同道,有没有遇到过这样的 ...
原帖由 fuyibin 于 2009-4-28 12:52 发表 登录/注册后可看大图 这是ADC 的offset,是正常的啊,不过好像有些偏大 offset主要是opamp的input offset造成的 前面有没有AFE?也会产生offset的 把这些offset统统折算到一起就ok了 不过你说的再详细一点,我可以估算一下输入of ...
原帖由 seetoo 于 2009-4-28 13:20 发表 登录/注册后可看大图 前面没有AFE,就是一个有中心抽头的balun,把单端信号转成差分信号。 运放是全差分套筒式运放,W/L为640.采样开关为栅压自举开关。 采样电容为1pF。 还需要什么信息么? 我起初也认为是运放的offset,但是 ...
原帖由 vdslafe 于 2009-4-28 14:25 发表 登录/注册后可看大图 一般就是offset 不过你的offset 太大了 你的INL,DNL如何? 还有可能是版图没画好,很多地方common-to-diff feedthrough 你跑过后仿没?
原帖由 fuyibin 于 2009-4-28 14:35 发表 登录/注册后可看大图 offset 电压有公式可以估算 vos= 30/sqrt(W*L)这是input pair的 把S/H+ MADC1+1/2*MDAC2+ 1/4*MDAC3+ 。。。求和
原帖由 ns2wei 于 2009-4-29 12:39 发表 登录/注册后可看大图 把单端信号转成差分信号试试看看
原帖由 seetoo 于 2009-4-29 12:30 发表 登录/注册后可看大图 INL和DNL很差的,测试的时候看起来噪声很大,还是不接交流输入信号时,输出的码就在偏码值附近略有抖动,大概在5~6个码的范围。 这应该是噪声的影响吧。 版图当时画的的确是比较赶,很多问题没有考虑到,据 ...
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