设为首页收藏本站
在线咨询
eetop公众号 创芯大讲堂 创芯人才网
切换到宽版

EETOP 创芯网论坛 (原名：电子顶级开发网)

手机号码，快捷登录

手机号码，快捷登录

找回密码

  登录   注册  

快捷导航
创芯云服务  : 创芯大讲堂  | 创芯人才网 | 数字IC职业培训  EETOP诚邀线上IC培训讲师!
搜帖子
EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › CPLDFPGA常用模块与综合系统设计实例精讲程序 ...
1234567下一页
返回列表 发新帖
楼主: sunqf2004

CPLDFPGA常用模块与综合系统设计实例精讲程序

[复制链接]
sonic1007
发表于 2013-5-2 09:14:49 | 显示全部楼层
顶啊~~~~~~~~~~~~~~~~~
回复 支持 反对

举报

servingapples
发表于 2013-5-2 10:50:45 | 显示全部楼层
怪不得这么小，原来就是vhdl代码……
EETOP创芯人才网简历投递入口
回复 支持 反对

举报

et-mac
发表于 2013-5-3 20:40:29 | 显示全部楼层
谢谢分享！
回复 支持 反对

举报

hbyu
发表于 2013-5-3 21:08:21 | 显示全部楼层
CPLD上用VHDL多还是Verilog多？
EETOP创芯人才网职位发布入口
回复 支持 反对

举报

国手大大
发表于 2013-5-6 17:15:45 | 显示全部楼层
回复 1# sunqf2004

多谢了啊!
EETOP创芯人才网简历投递入口
回复 支持 反对

举报

LadyHolly
发表于 2013-8-17 14:41:14 | 显示全部楼层
很不错的资料顶起来~~~~~
EETOP创芯人才网职位发布入口
回复 支持 反对

举报

Eleven_Luo
发表于 2013-8-17 19:47:33 | 显示全部楼层
是verilog，还是vHDL?
EETOP创芯人才网简历投递入口
回复 支持 反对

举报

glena
发表于 2014-3-11 22:22:24 | 显示全部楼层
EETOP创芯人才网职位发布入口
回复 支持 反对

举报

zzq81
发表于 2014-3-15 19:45:58 | 显示全部楼层
EETOP创芯人才网简历投递入口
回复 支持 反对

举报

lovencm
发表于 2014-3-17 12:00:37 | 显示全部楼层
谢谢分享
回复 支持 反对

举报

下一页 »
1234567下一页
返回列表 发新帖
高级模式
B Color Image Link Quote Code Smilies
您需要登录后才可以回帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /2 下一条

×

小黑屋| 关于我们| 联系我们| 在线咨询| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2024-4-28 01:17 , Processed in 0.037686 second(s), 7 queries , Gzip On, Redis On.

eetop公众号 创芯大讲堂 创芯人才网
快速回复 返回顶部 返回列表