菜鸟请教管脚分配问题

leigeleige · 发表于 2009-3-10 09:46:54

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刚接触ALTERA FPGA不久，做了一个简单的时序电路想要验证设计，仿真的结果是对的，但是下载到板子上结果出不来，小弟怀疑是管脚没有分配对，请问各位时钟端应该分配在哪一类的管脚上（开发板上有一个50mhz的晶振，小弟把时钟端分配在那个管脚上，结果出不来）
谢谢了！～

[ 本帖最后由 leigeleige 于 2009-3-10 09:48 编辑 ]

leigeleige · 发表于 2009-3-10 14:50:51

莫非没有高人指点？

caowangyang · 发表于 2009-3-10 16:15:40

我留个QQ给你，你加我，我们一起讨论一下吧，303731346

lingchen · 发表于 2009-3-11 09:01:54

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