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查看: 2395|回复: 17

电子书 State Machine Design Techniques for Verilog and VHDL

发表于 2009-2-3 10:49:19 | 显示全部楼层 |阅读模式

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很好的一本讲状态机设计的书。简单明了。

Design, 电子书, 设计

State Machine Design Techniques for Verilog and VHDL.pdf

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发表于 2009-2-4 02:34:38 | 显示全部楼层

Very good.

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发表于 2009-3-7 21:19:35 | 显示全部楼层

好东西，多谢

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发表于 2009-3-7 21:55:08 | 显示全部楼层

3q for share!

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发表于 2009-3-8 18:33:21 | 显示全部楼层

thanks a lo

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发表于 2009-4-27 11:57:12 | 显示全部楼层

这个比较适合初级人员吧

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发表于 2009-4-27 14:24:25 | 显示全部楼层

good doc!
thanks

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发表于 2009-5-20 22:31:22 | 显示全部楼层

不让灌水，哪有这么多资源

不让灌水，哪有这么多资源

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发表于 2010-3-9 14:21:18 | 显示全部楼层

too old

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发表于 2010-3-9 14:23:42 | 显示全部楼层

Thanks a lot.

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