求教：用spectreVerilog跑混合仿时Verilog代码跑不出来！

cathy.lrr · 发表于 2008-12-19 11:06:44

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求教为什么在modelsim下跑好的Verilog代码在spectreVerilog下跑不出来？输出全是零？为什么呀！
那位大侠知道的话，请不吝赐教，小妹甚是感激！

walker · 发表于 2008-12-19 15:05:11

1,检查下digital stimuli 设了没有

2，接口电平设置是否正确

jianbinma · 发表于 2009-1-8 17:42:48

最主要的就是有没有设端口电压的信息

qmq008 · 发表于 2010-6-29 22:28:37

新手帮顶

cc10000 · 发表于 2010-12-15 13:39:17

dddddd

ksg12 · 发表于 2011-4-21 17:22:06

shide .设置好电压阈值

samuel_lee · 发表于 2012-4-24 09:50:00

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