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状态机编程：State Machine Coding Styles for Synthesis

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dragonland

发表于 2008-11-16 00:50:06 | 显示全部楼层 |阅读模式

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状态机编程：State Machine Coding Styles for Synthesis

This paper details efficient Verilog coding styles to infer synthesizable state machines. HDL
considerations such as advantages and disadvantages of one-always block FSMs Vs. two-always
block FSMs are described.

advantages, Details, efficient, machines, 编程

状态机的编程.pdf

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状态机编程：State Machine Coding Styles for Synthesis

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