请教高手，这个差动三级振荡器为什么不起振

guang3000

图1是修改前的振荡器的电路图，为简明没连级联线。仿真的时候各种情况都可以起振，但流片后大概有40%的芯片不起振 ，或者有时起振，有时不起振。
如图2经过修改，在每个cell中加入两个二极管连接的pmos管后，流片后就能全部起振了。我在论文上看到的这类差动振荡器上面的负载好像很少是纯电流源的。我想了好久好久都没想到原因。请教高手，这是什么原因啊！谢谢！

[ 本帖最后由 guang3000 于 2008-9-20 10:08 编辑 ]

ccp106

你看看Razavi中文版P48的例3.3，有没有帮助，我是菜鸟，没办法解答

intercon

   

原帖由 guang3000 于 2008-9-18 15:21 发表

                               
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仿真的时候各种情况都可以起振，但流片后大概有40%的芯片不起振。

这可能是与版图或工艺有关吧，不一定是电路的问题，另外，LZ 第一张图用的是电流源负载，如何去调整Td 阿。感觉有点怪异哦

w98211012

书上p116图5.7有原型，其实为了改善增益的!

bkat

第一个工作点很难稳定,也就是说上电之后没能稳定在预设的工作点附近，不在放大状态，反而处于锁定状态，所以就不能起振了。
第二嘛由于二极管连接的存在，保证了各级放大器处于放大状态，所以就不存在这样的问题了。
总而言之 第二个结构可靠性比较好一点。

fuyibin

在三级差动环振中，每一级的gain和phase都是要满足一定条件的
相当于每一级相移60deg，接回输入时看到一个反响信号，这样整个环路就起振
楼主家了diode负载后，引入了diode的Cgs，每级相移加大，只要保证gain>2，整个环路就可以起振了
原来的可能相移太小

guang3000

   

原帖由 ccp106 于 2008-9-18 17:19 发表
你看看Razavi中文版P48的例3.3，有没有帮助，我是菜鸟，没办法解答

也很感谢啦

   

原帖由 intercon 于 2008-9-18 20:53 发表
这可能是与版图或工艺有关吧，不一定是电路的问题，另外，LZ 第一张图用的是电流源负载，如何去调整Td 阿。感觉有点怪异哦

每个cell的延时 = 输出端的电容 X 电流源的小信号电阻 ， 开始的时候我是这样想的。

   

原帖由 w98211012 于 2008-9-19 09:50 发表
书上p116图5.7有原型，其实为了改善增益的!

纯电流源负载应该增益更大才对啊

vdslafe

你看看delay cell phase 60 度的时候，gain 是不是大于1

w98211012

改善增益，并不一定非要使得增益变大！你这电路加了2级管负载后，输出端变成低阻抗极点!

guang3000

   

原帖由 vdslafe 于 2008-9-19 13:21 发表

                               
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你看看delay cell phase 60 度的时候，gain 是不是大于1

仿真过了，delay cell phase 60 时候为40db