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FPGA 设计全流程

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发表于 2008-9-6 09:00:53 | 显示全部楼层 |阅读模式

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FPGA 设计全流程:Modelsim>>Synplify.Pro>>ISE
第一章  Modelsim 编译 Xilinx 库
第二章  调用 Xilinx CORE-Generator
第三章  使用 Synplify.Pro 综合 HDL 和内核
第四章  综合后的项目执行
第五章  不同类型结构的仿真

Xilinx的FPGA设计全流程:Modelsim-》Synplify.Pro-》ISE.rar

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发表于 2008-9-6 13:21:26 | 显示全部楼层
正需要这样得资料呢!谢谢。
发表于 2008-9-8 09:42:09 | 显示全部楼层
先收藏起来
头像被屏蔽
发表于 2008-9-8 10:26:07 | 显示全部楼层
提示: 作者被禁止或删除 内容自动屏蔽
发表于 2008-9-12 17:28:01 | 显示全部楼层
才刚学,下下来看看。
发表于 2008-9-12 17:44:40 | 显示全部楼层
下来看看,谢谢!
发表于 2008-12-9 13:30:11 | 显示全部楼层
才刚学,下下来看看。
发表于 2008-12-13 17:06:15 | 显示全部楼层
下来看看把,不知道怎么样
发表于 2008-12-13 18:02:46 | 显示全部楼层
xiexie louzhu
发表于 2009-7-13 14:30:55 | 显示全部楼层
好东东啊。。。。
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