综合报告为什么没有指出关键路径?

tatata

我用ISE进行综合在报告的最出给出:

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Timing Summary:
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Speed Grade: -7

   Minimum period: 17.389ns (Maximum Frequency: 57.506MHz)
   Minimum input arrival time before clock: 5.329ns
   Maximum output required time after clock: 3.293ns
   Maximum combinational path delay: No path found

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Process "Synthesis" completed successfully

但是没有关于Maximum combinational path delay的信息，这是为什么呀？？？
请高手指点一下！！谢谢！！！

wakingbefore

大哥关键路径是后仿的时候看的吧