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楼主: maxsnail

大家都已被synopsys洗脑了

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发表于 2008-8-20 13:04:12 | 显示全部楼层
发表于 2008-8-20 23:16:20 | 显示全部楼层


原帖由 loveineda 于 2008-8-20 13:04 发表


楼主真TMD的,被猪踢蠢啦,难道SystemC,Systemverilog不是工具吗



Well... in my view, SystemC and Systemverilog are Languages, not Tools. Tools for example will be the editor for these languages.
发表于 2008-8-20 23:20:13 | 显示全部楼层
which one is better... 见仁见智 lor.

personally, i think SystemVerilog is bette, because it is a combination of systemC and Verilog, good for both design and verification.
发表于 2008-8-21 11:23:49 | 显示全部楼层


原帖由 evn 于 2008-8-20 23:16 发表


Well... in my view, SystemC and Systemverilog are Languages, not Tools. Tools for example will be the editor for these languages.


假洋鬼子:语言是不是工具?????
发表于 2008-8-21 21:52:48 | 显示全部楼层
关键是作数字设计的人都是硬件出身,很少有很深刻的C++的思维方式,这是systemC推广受阻最根本的原因,窃以为!
发表于 2008-9-11 15:23:55 | 显示全部楼层
鄙视乱说的
发表于 2008-9-12 22:31:15 | 显示全部楼层
ding 一下啊。。。。。。。。。。。
发表于 2008-9-14 02:35:01 | 显示全部楼层
没办法, 新思现在强啊
发表于 2008-9-16 16:23:39 | 显示全部楼层
不知楼主是不是发牢骚,如果你能给出更全面的证据来,我们也许还能接受......
发表于 2008-9-20 00:15:25 | 显示全部楼层
thanks for sharing !
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