请教！有关wishbone总线的问题

crazyraul008 · 发表于 2008-7-8 21:53:55

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最近看到wishbone总线标准的资料，有个问题想请教一下：

wishbone分为master interface和slave interface，对于master interface的定义和slave interface的定义是不一样的，

一般都是作为master的控制器主动向作为slave的单元发起总线读写操作。

我想问的问题是：如果设计的slave单元也想主动发起总线操作，要怎么办？

比如现在master单元要读slave单元的数据，就可以主动发出读数据操作，但如果master单元并不知道什么时候该读slave单元的数据，

而是要由slave单元来通知master单元什么时候该读数据了，那应该怎么办？

我所看到的资料中，好像slave不能主动发起总线操作的，至少接口定义中地址总线是输入的（ADR_I）

望大虾们指点一下！

klmn985 · 发表于 2008-7-11 10:32:47

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zsan566 · 发表于 2010-8-15 10:07:53

帮你顶一下！

yuanwolf2008 · 发表于 2010-9-28 10:55:31

你让slave单元也支持mater操作，或者同一单元即可以是master也可以是slave

klmn985 klmn985 当前离线积分 143 头像被屏蔽	发表于 2008-7-11 10:32:47 \| 显示全部楼层提示: 作者被禁止或删除内容自动屏蔽
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