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1 Introduction 2
Project structure . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2
2 The CML Technology 4
Basics of MCML . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4
MCML vs CMOS . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5
Classical CMOS Logic Inverter . . . . . . . . . . . . . . . . 5
MOS Current-Mode Inverter . . . . . . . . . . . . . . . . . . 8
Advantages an disadvantages of this technology . . . . . . 10
Levels and gates . . . . . . . . . . . . . . . . . . . . . . . . . . . . 11
3 The design process 15
Design parameters . . . . . . . . . . . . . . . . . . . . . . . . . . 15
Analysis . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 16
Testbench and analog environement . . . . . . . . . . . . . 16
Corners . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18
Multiple drive strengths . . . . . . . . . . . . . . . . . . . . 22
Guard ring . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 26
4 Results 27
Level 1 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 28
First generation . . . . . . . . . . . . . . . . . . . . . . . . . 28
Second generation . . . . . . . . . . . . . . . . . . . . . . . 29
Level 2 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 32
First generation . . . . . . . . . . . . . . . . . . . . . . . . . 32
Design of MOS Current-Mode Logic Standard Cells “ ii
Second generation . . . . . . . . . . . . . . . . . . . . . . . 32
Third generation . . . . . . . . . . . . . . . . . . . . . . . . . 32
Level 3 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 36
First generation . . . . . . . . . . . . . . . . . . . . . . . . . 36
Second generation . . . . . . . . . . . . . . . . . . . . . . . 39
Third generation . . . . . . . . . . . . . . . . . . . . . . . . . 41
The final layouts . . . . . . . . . . . . . . . . . . . . . . . . . . . . 42
Sizes of the cells . . . . . . . . . . . . . . . . . . . . . . . . . . . . 48 |
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发表于 2008-6-11 11:25:38
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