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verilog的仿真和综合软件 Icarus Verilog-0.8

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发表于 2008-5-24 23:38:49 | 显示全部楼层 |阅读模式

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Icarus Verilog is a Verilog simulation and synthesis tool. It operates as a compiler, compiling source code writen in Verilog (IEEE-1364) into some target format. For batch simulation, the compiler can generate an intermediate form called vvp assembly. This intermediate form is executed by the ``vvp'' command. For synthesis, the compiler generates netlists in the desired format.
具体介绍见:http://www.icarus.com/eda/verilog/

iverilog-0.8-setup.part1.rar

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发表于 2009-1-22 22:12:59 | 显示全部楼层
thank you very much
发表于 2009-1-22 22:14:25 | 显示全部楼层
!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!
发表于 2009-1-27 12:19:11 | 显示全部楼层

感谢ing,收藏中

感谢ing,收藏中
发表于 2009-2-19 20:29:10 | 显示全部楼层
很好谢谢了
发表于 2009-4-14 20:35:43 | 显示全部楼层

ding

ding xia  xian    wo xia lai kan kan
发表于 2009-5-6 11:01:59 | 显示全部楼层
tf34klgnjt34ljtgmop3jtgop34tg
发表于 2009-5-6 11:03:04 | 显示全部楼层

3141234

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发表于 2009-5-6 11:08:19 | 显示全部楼层
房管部门老干部三大法宝
发表于 2009-5-6 11:10:03 | 显示全部楼层
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