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楼主: A9107114

如何預防設計出的邏輯電路產生Glitch

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发表于 2009-9-16 15:22:25 | 显示全部楼层
没看懂
发表于 2009-9-17 11:05:29 | 显示全部楼层
其实引用了同步设计就能很大程度上减小毛刺的产生!
发表于 2009-9-17 12:39:27 | 显示全部楼层
ddddddddddddddddddddddddddd
发表于 2009-9-17 12:48:54 | 显示全部楼层
下来看看,学习一下!
发表于 2009-9-18 09:12:45 | 显示全部楼层
支持一个
发表于 2010-3-17 23:20:58 | 显示全部楼层
谢谢LZ分享
发表于 2010-3-18 07:15:49 | 显示全部楼层
normally, people do synchronize design to avoid glitch
but you need to be very careful when deal with asynchronize design such as switch clock.
发表于 2010-3-18 10:00:14 | 显示全部楼层
非常好!
发表于 2010-8-17 16:07:16 | 显示全部楼层
thank you~
发表于 2010-8-18 08:43:07 | 显示全部楼层
thanks for sharing
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