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发表于 2008-4-10 11:31:26
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本人使用quartus II 的SignalTap II工具来看FPGA内的信号,做法是: 先把你要实现的功能编制完成后,让quartus分析下( 或者可以先综合下也可以) ,然后点quartus软件的工具里的SignalTap II,quartus就会启动它,然后把你要看的信号加入SignalTap II中(注意下你的FPGA的资源,太多信号和过大的采样深度会耗费你FPGA太多的资源的),然后编译,下载到FPGA中就可以看到你要看的信号了(SignalTap II的使用可以看相关资料);
至于你说的要使用FPGA上的PLL可以用quartus软件中自带的IP核,名字应该是ALTPLL这类的,把输入时钟的管脚与你的晶振相连,填上输入频率和调节IP核的系数或者直接在输出频率上填上你要的输出频率就可以(注意一点,PLL的输出频率与你的输入频率和PLL的倍频、分频系数有关,有时候你填的输出频率,它会告诉你不可用的,并显示为红色);
在这里就回答你第2和第3个问题 |
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