如何在Virtuoso中建一个比库中电容小的电容

踟蹰的天 · 发表于 2022-7-4 15:43:47

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我在做一个SAR ADC，为了降低输入buffer的功耗，我想尽可能地降低电荷重分配DAC的电容。由于9bitADC所需的单位电容远小于我所采用的工艺库的mimcap，所以我希望自己搭一个电容。请问要怎么设置？或者有没有类似的教程贴？

感谢

清风徐徐来 · 发表于 2022-7-4 16:43:34

电容串联

iTaogo · 发表于 2022-7-4 17:28:35

layout自己画,定制电容

踟蹰的天 · 发表于 2022-7-5 00:21:28

清风徐徐来发表于 2022-7-4 16:43
电容串联

串联会不会引入什么奇奇怪怪的噪声啊

踟蹰的天 · 发表于 2022-7-5 00:26:22

iTaogo 发表于 2022-7-4 17:28
layout自己画,定制电容

定制电容做起来复杂吗？有没有什么教程之类的？谢谢

neonato · 发表于 2022-7-5 17:12:35

可以考虑用MOM电容，用METAL的侧壁间寄生，不少PDK有这个选项

温柔的国王 · 发表于 2022-7-5 20:29:32

customize吧，工艺小的话就用fringe cap，自己花layout，减少finger数量和叠的金属层数就行，然后extraction。

踟蹰的天 · 发表于 2022-7-5 20:48:11

neonato 发表于 2022-7-5 17:12
可以考虑用MOM电容，用METAL的侧壁间寄生，不少PDK有这个选项

好的，我去看看，感谢

踟蹰的天 · 发表于 2022-7-5 21:53:45

温柔的国王发表于 2022-7-5 20:29
customize吧，工艺小的话就用fringe cap，自己花layout，减少finger数量和叠的金属层数就行，然后extractio ...

请问fringe cap和MOM cap是一回事儿么？

温柔的国王 · 发表于 2022-8-11 19:22:50

踟蹰的天发表于 2022-7-5 21:53
请问fringe cap和MOM cap是一回事儿么？

对，一回事。最近事多没怎么上论坛，回复晚了，见谅。

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