高压电平移位电路

maxinyi · 发表于 2020-7-31 15:11:51

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结构如图，但是增加管子的下拉能力也没有办法把输出拉到地，仿真如下图，应该怎么做呢
(JD89~W4I((U8MFCJ4L2~OY.png

piao · 发表于 2022-11-9 23:00:47

thanks for sharing

hieli · 发表于 2021-7-9 21:03:30

拉低的话后面PMOS管更一直是导通的

SClearner · 发表于 2021-7-9 12:46:52

我仿这个电路M1管会击穿啊，楼主有打开击穿报警吗

maxinyi · 发表于 2020-8-2 08:54:05

侯门似海发表于 2020-7-31 22:08
试下去掉M5和M6

去掉也不行

侯门似海 · 发表于 2020-7-31 22:08:48

试下去掉M5和M6

maxinyi · 发表于 2020-7-31 17:18:37

fengluan83 发表于 2020-7-31 16:31
Vx,Vy接后级的pmos，不需要拉低啊

不拉低的话后面PMOS管一直是导通的，输出一直在高电平上

fengluan83 · 发表于 2020-7-31 16:31:19

Vx,Vy接后级的pmos，不需要拉低啊

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