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[原创] cadence仿真眼图

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发表于 2013-10-28 13:00:54 | 显示全部楼层 |阅读模式

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本帖最后由 lskybs 于 2013-10-28 13:05 编辑

对于眼图仿真纠结了很长一段时间,由于我所涉及都得系统是关于光接收机的,所以需要考虑当输入电平信号时,输出电平的问题,很大情况是噪声对整个系统的影响,那么需要结合眼图来观察整个系统的性能,由于接触specture时间不是很长,对于库里面的model都不是很熟悉,所以在做眼图仿真的时候碰到了一些问题,由于论坛对眼图仿真好像介绍的并不多,同时也不是很详细,所以在这个帖子中介绍了眼图仿真的步骤,可能也不是很详细,很正确,望大家指导。同时希望帮我分析一下从下面的眼图中可以得到系统中存在哪些问题,谢谢!!
(1)首先,眼图仿真的系统需要有一个电平脉冲信号,cadence自带的ahd1lib库中的rand-bit-stream这个model可以得到随机的数字序列,这个模型的设置如下图所示,其中tperiod为数字序列周期,seed具体这么填我也不是很清楚,希望懂的人可以指导,下面的vlogic为电平的高低,trise和tfall表示上升和下降沿所用时间。这样就设置好了这个model,将其接入系统输入端即可。

rand-bit-stream设置

rand-bit-stream设置

(2)其次,对于眼图的观察一般应用在频率相对较高的系统中,如果频率较低,系统的串扰和噪声的影响相对较小,所以通过眼图看不出什么现象,下图一所以为当输入的随机的数字序列为5Gbps的情况下输出所得数字序列,图二为其所对应的眼图:
Random-bit-output-5G.png
图一:系统输出5Gbps序列
5Gbpseyedia.png
图二:系统输出5Gbps眼图
得到系统输出的数字序列后,在IC6151中可以根据下图所示的步骤得到眼图,在IC5141中不知道什么样子的,我想应该是差不多的:
333.png 点击Eye Diagram得到下图所示框图:
4444.png period这一栏可能需要设置好,具体如何根据自己系统所需要输入的数字序列的频率大小而定,否则眼图没办法输出很标准。

下图一所示是输出数字序列为10Gbps的图形,图二为其对应的眼图。请各位大神们根据所得的眼图帮忙分析这个系统的噪声和串扰情况,谢谢了!

10Gbps系统输出数字序列

10Gbps系统输出数字序列

图一:系统输出10Gbps序列

10Gbps系统输出眼图

10Gbps系统输出眼图

图二:系统输出10Gbps眼图

如有错误,望指正!!谢谢!
发表于 2025-9-28 11:51:07 | 显示全部楼层
感谢分享
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发表于 2024-1-19 17:53:26 | 显示全部楼层
感谢,看完帖子很有收获
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发表于 2022-12-30 11:08:01 | 显示全部楼层
谢谢多谢
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发表于 2021-8-28 19:17:21 | 显示全部楼层
学习了,谢谢分享
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发表于 2021-8-18 10:21:02 | 显示全部楼层
谢谢分享
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发表于 2020-12-11 16:34:24 | 显示全部楼层
然而你得到的眼图是错的
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发表于 2020-6-5 13:58:55 | 显示全部楼层
学习了,最近在学习时钟抖动的内容,学习了
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发表于 2020-4-26 14:59:04 | 显示全部楼层
看看
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发表于 2020-3-30 16:33:41 | 显示全部楼层
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