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[原创] 承包后端设计 ...2 3	idbi 2010-4-20	216895	jiancongwoo 2011-3-16 07:39
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[原创] 请问calibre+smartspice可以做后仿吗？	hewu 2011-1-9	12235	hewu 2011-1-9 15:55
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[原创] 讨论：sram和rom这些同步模块，在ClockGating中是如何被处理的？？？	orinoflow 2010-10-27	72711	huori 2010-12-22 23:48
[原创] 请问有人联系过封装和测试厂吗	xiaox 2010-3-22	53034	山水一色 2010-12-20 21:05
[原创] voltagestorm问题相关	sh_0119 2010-12-6	02307	sh_0119 2010-12-6 11:26
[原创] 讨论GTETCH网表该如何综合的问题！！！	orinoflow 2010-11-19	25070	hiyoun 2010-11-23 00:19
[原创] TTL-CMOS电平转换问题？	christing 2010-9-9	22638	ericyz1998 2010-11-19 07:33
[原创] 已过期，请删帖	2004changhe 2010-11-6	02182	2004changhe 2010-11-6 10:14
[原创] 讨论一个在ClockGating时候遇到的典型问题！！！！	orinoflow 2010-10-27	83918	empty_085 2010-11-5 20:58
[原创] power compiler 流程	bestyanjun 2010-7-20	63522	smn1380 2010-10-17 01:49
[原创] CLK 周围地线的作用？ ...2	ira2008 2010-8-26	155900	smn1380 2010-10-16 13:01
[原创] 有人需要ultra10工作站的吗？	suntou 2010-10-15	02312	suntou 2010-10-15 22:05
[原创] 大家信号完整性分析用什么工具呀？	wqx 2009-12-14	65231	jiancongwoo 2010-10-1 09:47
[原创] 关于DC综合compile_ultra的问题	abao123 2010-8-26	410960	zb8521 2010-9-22 01:45
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