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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog Layout（版图） › Layout讨论区 › smic40中的DNW res是什么层
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查看: 194|回复: 5

[原创] smic40中的DNW res是什么层

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Annie_kyohou
发表于 前天 17:44 | 显示全部楼层 |阅读模式

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smic40中的DNW res是什么层？为什么不盖它会出LVS问题？现在主要的问题是它的purpose是res，其中的res又是什么的简称吗？
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522526tl
发表于 昨天 09:45 | 显示全部楼层
resistor?
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Annie_kyohou
 楼主| 发表于 昨天 09:55 | 显示全部楼层


522526tl 发表于 2024-12-25 09:45
resistor?


它是盖在DNW NMOS上的哦
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bing_bing
发表于 昨天 10:11 | 显示全部楼层
rule里面的解释是：LVS six terminal DNW MOS
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速写IC
发表于 昨天 14:05 | 显示全部楼层
工艺问题，我的理解是DNW识别层，设计规则应该有说
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本征半导体
发表于 昨天 16:05 | 显示全部楼层
井电阻，deep nwell resistor
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