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[求助] verdi 不显示uvm hier

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发表于 2024-11-12 10:16:53 | 显示全部楼层 |阅读模式

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加了选项,怀疑是2020版本的问题,或者是rule.rc的问题,有前辈遇到这种问题吗

                               
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发表于 2024-11-14 09:32:22 | 显示全部楼层
建议使用synopsys发布的testsuite的风格,把每一个test.sv都在test_top这个tb最顶层module中include起来,这样使用-lca -kdb编译,使用verdi打开,在verdi代码中,双击某个test,就能在左边看到uvm的hierarchy了
发表于 2024-11-29 18:00:35 | 显示全部楼层
是不是加错地方了,debug_access是编译选项,verdi_trace是仿真选项
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