fpga后仿

verify0906 · 发表于 2022-6-8 18:03:43

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本帖最后由 verify0906 于 2022-6-8 18:05 编辑

求教下大佬，
altera的fpga可以用vcs做后仿吗，编译和反标都没啥问题，然后一到simv的时候就崩了，一堆libc.o main等的报错
quartus调modelsim是可以跑得，然后今天看反标文件，里面写着
“This SDF file should be used for ModelSim （Verilog）only”
请问这个还有救吗。。。

gaurson · 发表于 2022-6-9 17:40:59

1、最好把VCS跑的报错，选几个典型的，发来看看；
2、quartus可以跑，但你的意思是没有反标成功，是这样吗？

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