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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog Layout（版图） › Layout讨论区 › lvs问题
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楼主: lovefly519

[求助] lvs问题

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lovefly519
 楼主| 发表于 2017-3-15 11:09:23 | 显示全部楼层
回复 10# Yestare


   netlist 应该不会有问题  不然也过不了lvs
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fzj1992130
发表于 2017-3-15 11:13:23 | 显示全部楼层
报告贴出了看看
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dqyang
发表于 2017-3-15 16:34:51 | 显示全部楼层
回复 5# lovefly519

打开commandfile file highlight power_name和ground_name看用在什么地方就知道对lvs有什么影响了
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