求助：systemverilog中可以根据config来决定使用上升沿还是下降沿么？

oscillator_cn1 · 发表于 2012-7-3 08:47:25

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各位：
   最近在学着折腾UVM，可是systemverilog的基础没打结实，遇到一些问题不敢随便确定，所以来问问大家。我可以写这样的代码么：
   if(cfg.polarity)
      @(posedge vif.hs)
   else if(~cfg.polarity)
      @(negedge vif.hs)
         ......