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Warning: Comparison with unknown, don't care or tristate will always be false, may cause simulation and synthesis mismatch
Error: RTL interpretation messages were produced during link.
Verification results may disagree with a logic simulator. (FM-089)
Error: Failed to set top design to 'r:/WORK/can_core' (FM-156)
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所以得底层模块都可以matche，而最后到了顶层模块竟出现这个问题，看错误说明是因为代码风格的问题，可以底层的模块都没问题，顶层模块只是调用这些模块，为什么会出现这个问题。 |
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发表于 2010-7-23 21:56:18
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