设为首页收藏本站
在线咨询
eetop公众号 创芯大讲堂 创芯人才网
切换到宽版

EETOP 创芯网论坛 (原名：电子顶级开发网)

手机号码，快捷登录

手机号码，快捷登录

找回密码

  登录   注册  

快捷导航
创芯云服务  : 创芯大讲堂  | 创芯人才网 | 数字IC职业培训  EETOP诚邀线上IC培训讲师!
搜帖子
EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › Verilog HDL Synthesis A Practical Primer
返回列表 发新帖
查看: 1363|回复: 6

Verilog HDL Synthesis A Practical Primer

[复制链接]
mimox
发表于 2009-5-21 19:36:39 | 显示全部楼层 |阅读模式

马上注册，结交更多好友，享用更多功能，让你轻松玩转社区。

您需要 登录 才可以下载或查看，没有账号？注册

x
english version!
English, lol, Version

Verilog HDL Synthesis A Practical Primer.rar

4.75 MB, 下载次数: 31 , 下载积分: 资产 -3 信元, 下载支出 3 信元

相关帖子
回复

举报

scallion
发表于 2009-5-22 17:06:44 | 显示全部楼层

1998 年的书

1998 年的书
EETOP创芯人才网简历投递入口
回复 支持 反对

举报

demonyh
发表于 2009-5-24 14:21:38 | 显示全部楼层
thanks for sharing
回复 支持 反对

举报

zyxandsc
发表于 2009-8-4 13:58:50 | 显示全部楼层
看看，
回复 支持 反对

举报

huatiantian
发表于 2010-7-16 11:32:28 | 显示全部楼层
good good good
EETOP创芯人才网简历投递入口
回复 支持 反对

举报

caosl
发表于 2010-7-23 14:11:52 | 显示全部楼层
好书啊。。。。。
EETOP创芯人才网职位发布入口
回复 支持 反对

举报

craybird
发表于 2010-8-17 00:20:26 | 显示全部楼层
cool...
EETOP创芯人才网简历投递入口
回复 支持 反对

举报

返回列表 发新帖
高级模式
B Color Image Link Quote Code Smilies
您需要登录后才可以回帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /1 下一条

如何优化 SoC 设计

小黑屋| 手机版| 关于我们| 联系我们| 在线咨询| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2024-11-19 14:29 , Processed in 0.022505 second(s), 10 queries , Gzip On, Redis On.

eetop公众号 创芯大讲堂 创芯人才网
快速回复 返回顶部 返回列表